| 單價(jià)： | 面議 |
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| 所在地： | 直轄市 北京 |
| 有效期至： | 長(zhǎng)期有效 |
| 發(fā)布時(shí)間： | 2023-12-20 03:31 |
| 最后更新： | 2023-12-20 03:31 |
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ddr、DDR一致性測(cè)試，信號(hào)完整系測(cè)試
以通用計(jì)算機(jī)主板上的DDR2總線(xiàn)為例，DDR2信號(hào)線(xiàn)可以分為數(shù)據(jù)、命令、時(shí)鐘3部分。其中數(shù)據(jù)線(xiàn)部分主要完成數(shù)據(jù)傳輸工作，包括數(shù)據(jù)線(xiàn)DQ0-63、Data Mask線(xiàn)DM0-7、數(shù)據(jù)同步線(xiàn)DQS/DQS# (數(shù)據(jù)同步線(xiàn)可選單端或差分，通過(guò)設(shè)定內(nèi)存芯片內(nèi)部寄存器EMR[1]的A10位進(jìn)行選擇)；命令線(xiàn)部分包括地址線(xiàn)A0-14、Bank選擇線(xiàn)BS0-2、行地址選擇RAS#、列選擇CAS#、寫(xiě)使能WE#、片選CS#、時(shí)鐘使能CKE及芯片內(nèi)部終端電阻使能ODT組成，主要完成尋址、組成各種控制命令及內(nèi)存初始化工作；差分時(shí)鐘信號(hào)線(xiàn)CK/CK#為整個(gè)內(nèi)存芯片工作提供時(shí)鐘。